三维集成电路的布图规划/布局算法研究
基本信息
批准号：60572015
项目类别：面上项目
资助金额：24.00
负责人：徐宁
学科分类：
依托单位：武汉理工大学
批准年份：2005
结题年份：2008
起止时间：2006-01-01 - 2008-12-31
项目状态： 已结题
项目参与者：朱小科,谈冉,吴青,毛雪涛,俞立伟,钟原
关键词：
电子设计自动化算法三维集成电路布图规划/布局
结项摘要
随着集成电路规模的不断扩大，三维集成电路已成为今后集成电路的发展趋势。它与二维集成电路相比具有互连线短、集成度高、芯片面积小和功耗低等特点。因此，三维集成电路成为当今学术界研究的热点课题。布图技术是集成电路设计中最重要的一步，而布图规划/布局是关键，其结果的好坏直接影响芯片的制造和封装。本课题以现有二维集成电路布图规划/布局算法为基础，研究适合于三维集成电路的布图规划/布局算法，包括三维布图规划/
项目摘要
项目成果
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数据更新时间：2023-05-31
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