本项目面向超深亚微米工艺下高性能VLSI设计中的时钟偏移问题、片内外数据交换对I/O控制时钟相位的要求及低功耗设计需求,重点研究动态自适应时钟偏移调整算法、分布式时钟相位检测及时钟偏移快速调整电路的设计优化技术、时钟分布网络的低功耗设计技术,提出基于VLSI芯片物理设计区域分划、分布式时钟相位检测、动态自适应时钟偏移调整算法及基于该时钟偏移调整模式的时钟分布网络设计优化方法,设计出支持该方式的快速
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数据更新时间:2023-05-31
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